多核系统设计并发数据结构时,如何减少缓存同步和锁广播开销?

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如果是在多核 CPU 的架构下,跨 CPU 核心的缓存同步和锁广播开销会更突出,针对这种多核 CPU 之间的广播问题,你会怎么设计优化?
那更泛化来讲,针对多线程运行在多核 CPU 的场景,你做并发数据结构设计的核心思路是什么?

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